AD6620ASZ

Receptor digital AD6620 con cuatro elementos de procesamiento de señal en cascada, un traductor de frecuencia, dos filtros de diezmado de coeficiente fijo y un filtro de diezmado de coeficiente programable. Todas las entradas son compatibles con LVCMOS de 3.3V. Todas las salidas son compatibles con LVCMOS y 5 V TTL. A medida que los ADC logran tasas de muestreo y rango dinámico más altos, se vuelve cada vez más atractivo lograr la etapa final de FI de un receptor en el dominio digital. El procesamiento de FI digital es menos costoso, más fácil de fabricar, más preciso y más flexible que una etapa analógica altamente selectiva comparable. Este receptor de diezmado de canales de diversidad está diseñado para cerrar la brecha entre los ADC de alta velocidad y los DSP de uso general. El NCO de alta resolución permite seleccionar una sola portadora de un flujo de datos de alta velocidad. Los filtros de diezmado de alto rango dinámico con una amplia gama de tasas de diezmado permiten extraer portadoras de banda estrecha y de banda ancha.

• Frecuencia de muestreo de entrada alta, traducción de frecuencia NCO
• Peine integrador en cascada de segundo orden Filtro FIR Fase lineal, coeficientes fijos
• Peine integrador en cascada de quinto orden Filtro FIR Fase lineal, coeficientes fijos
• Filtro FIR de coeficiente RAM diezmador programable
• Circuito de sincronización bidireccional, fase alinea NCO
• Sincroniza relojes de salida de datos, salidas de banda base seriales y paralelas, pin seleccionable serial/paralelo
• Puerto paralelo de 16 bits, salidas I y Q intercaladas, dos puertos de control y configuración separados
• Puerto µP genérico, puerto serie, exploración de límites JTAG
• La compatibilidad lógica típica es CMOS de 3.3V
• Paquete PQFP de 80 terminales, rango de temperatura ambiente de -40 a +85 °C

Notas

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