AD9231BCPZ-80

El AD9231 es un ADC monolítico de doble canal de 12 bits y 80MSPS. El ADC contiene varias funciones diseñadas para maximizar la flexibilidad y minimizar el costo del sistema, como la alineación de datos y reloj programable y la generación de patrones de prueba digitales programables. Los patrones de prueba digitales disponibles incluyen patrones deterministas y pseudoaleatorios incorporados, junto con patrones de prueba personalizados definidos por el usuario ingresados a través del SPI. Una entrada de reloj diferencial controla todos los ciclos de conversión internos. Un estabilizador de ciclo de trabajo (DCS) opcional compensa las amplias variaciones en el ciclo de trabajo del reloj mientras mantiene un excelente rendimiento general de ADC. Las aplicaciones típicas incluyen comunicaciones, sistemas de radio de diversidad, receptores digitales multimodo (GSM, EDGE, W-CDMA, LTE, CDMA2000, WiMAX, TD-SCDMA), sistemas de demodulación I/Q, sistemas de antena inteligente, instrumentos alimentados por batería, osciloscopios portátiles , imágenes médicas portátiles, ultrasonido, Radar/LIDAR.

• Operación de suministro analógico de 1.8V y suministro de salida de 1.8V a 3.3V
• SNR de 71.3dBFS a entrada de 9.7MHz y 69dBFS a entrada de 200MHz
• SFDR de 93dBc a entrada de 9.7MHz y 83dBc a entrada de 200MHz
• Potencia de espera de 37mW y potencia de apagado de 2.2mW
• Entrada diferencial con ancho de banda de 700MHz
• Referencia de voltaje en el chip y circuito de muestreo y retención
• Diferencial de 2V p-p y estabilizador de ciclo de trabajo de reloj opcional
• Compensación binaria, código gris o dos complementos de formato de datos y modos de apagado para ahorro de energía
• Divisor de reloj de entrada entero de 1 a 8 y salida de reloj de datos con reloj y datos programables
• Paquete LFCSP-VQ-EP de 64 derivaciones, rango de temperatura de funcionamiento de -40°C a 85°C

Notas

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