AD9528BCPZ-REEL7

El AD9528 es un PLL de dos etapas con un generador de reloj JESD204B/ JESD204C SYSREF integrado para la sincronización de múltiples dispositivos. El bucle de enganche de fase (PLL) (PLL1) de la primera etapa proporciona acondicionamiento de referencia de entrada al reducir la fluctuación presente en un reloj del sistema. El PLL de segunda etapa (PLL2) proporciona relojes de alta frecuencia que logran un jitter integrado bajo, así como un ruido de banda ancha bajo de los controladores de salida del reloj. El VCXO externo proporciona la referencia de bajo ruido requerida por PLL2 para lograr los requisitos de fluctuación y ruido de fase restrictivos necesarios para lograr un rendimiento aceptable. La aplicación incluye transceptores inalámbricos de alto rendimiento, estaciones base LTE y GSM multiportadora, infraestructura inalámbrica y de banda ancha, instrumentación médica, ADC de reloj de alta velocidad, DAC, DDS, DDC, DUC, MxFE; admite JESD204B/JESD204C, jitter bajo, distribución de reloj de ruido de fase baja, ATE e instrumentación de alto rendimiento.

• Divisores de 8 bits dedicados en cada salida
• La frecuencia de salida máxima es de 1000MHz (todas las salidas, TA -40 °C a +85 °C)
• El sesgo típico de salida a salida es de 20ps
• El ciclo de trabajo típico es 50% (f <lt/> 500MHz, -40°C a +85°C)
• Detección de bloqueo de frecuencia digital, puerto de control serie compatible con SPI e I²C
• PLL1, proporciona limpieza de reloj de entrada de referencia con VCXO externo
• Tasa de detección de fase de hasta 110MHz, entradas de referencia redundantes
• Modos de conmutación de referencia automática y manual, conmutación reversible y no reversible
• Paquete LFCSP de 72 terminales
• Rango de temperatura de -40 °C a +85°C

Notas

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