AD9546BCPZ

El AD9546 es un sincronizador de reloj digitalizado DPLL dual. Incorpora tecnología de reloj digitalizado que transporta y distribuye eficientemente señales de reloj en los sistemas. El reloj digitalizado permite el diseño de sistemas de transporte de reloj flexibles y escalables con una alineación de fase (temporal) bien controlada. Estas características hacen del AD9546 una opción líder para el diseño de equipos de red que deben cumplir con los requisitos de sincronización para relojes límite IEEE® 1588™ según ITU-T G.8273.2 Clase D. El reloj digitalizado también es relevante en aplicaciones que requieren el transporte preciso de frecuencia. y fase a múltiples puntos finales de uso. Es compatible con los estándares existentes y emergentes de la Unión Internacional de Telecomunicaciones (UIT) para la entrega de frecuencia, fase y hora del día a través de redes de paquetes de proveedores de servicios.

• Subsistema de transporte de reloj digitalizado, modos rápidos de bloqueo DPLL
• Cross point mux interconecta entradas de referencia a PLL
• Admite señales de reloj de entrada/salida integradas (moduladas)
• Soporte externo de EEPROM para inicialización autónoma
• La corriente VDDIOx típica (IVDDIOx) es 5 mA (corriente agregada para todos los pines VDDIOx (donde x=AorB)
• La configuración típica de disipación de potencia es de 585mW (fOSC=cristal de 49.152MHz; dos DPLL activos)
• La referencia de entrada tipo diferencial encendido/apagado (modo acoplado a CA) es 20mW (frecuencia de referencia (fREF) = 19.44MHz)
• La referencia de entrada típica On/Off (de un solo extremo) es 13mW (fREF=19.44MHz, VDD=1.8V)
• Rango de frecuencia de entrada de 20 a 300MHz (VDD=1.8V)
• Paquete LFCSP de 48 conductores, rango de temperatura de -40°C a +85°C

Notas

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