AD9571ACPZLVD

El AD9571 proporciona una función de generador de reloj Ethernet de múltiples salidas que comprende un núcleo PLL dedicado que está optimizado para aplicaciones de tarjeta de línea Ethernet. El diseño de PLL de N entero se basa en la cartera probada de sintetizadores de frecuencia de baja fluctuación y alto rendimiento de Analog Devices, Inc. para maximizar el rendimiento de la red. Otras aplicaciones con exigentes requisitos de fluctuación y ruido de fase también se benefician de esta parte. La sección PLL consta de un detector de frecuencia de fase (PFD) de bajo ruido, una bomba de carga de precisión, un oscilador controlado por voltaje de bajo ruido de fase y un divisor de retroalimentación y un divisor de salida preprogramados. Al conectar un cristal externo o un reloj de referencia al pin REFCLK, se pueden bloquear frecuencias de hasta 156.25MHz en la referencia de entrada. La aplicación incluye tarjetas de línea Ethernet, conmutadores y enrutadores, SCSI, SATA y PCI-express, soporte PCI incluido, baja fluctuación y generación de reloj de bajo ruido de fase.

• Núcleo VCO/PLL totalmente integrado
• El ancho de banda de integración de fluctuación es de 0.17ps rms (típico, 156.25MHz, VS = 3.3V, TA = 25°C)
• Cristal de entrada o frecuencia de reloj de 25MHz
• Elección de formato de salida LVPECL o LVDS, filtro de bucle integrado
• 6 copias de la salida del reloj de referencia, velocidades configuradas mediante pasadores de fleje
• Las características del ruido de fase son -120 dBc/Hz (típico, salida de 33.33MHz desactivada, TA = 25 °C, a 1 KHz)
• La frecuencia de entrada es de 25MHz (tipo, vs = 3.3V ± 10%, a = 25 ° C)
• La frecuencia de salida es de 156.25MHz (máx., VS = 3.3V ±10%, TA = 25°C)
• Rango de ciclo de trabajo de 45 a 55% (VS = 3.3V ±10 %, TA = 25 °C)
• Paquete LFCSP-WQ de 40 terminales, rango de temperatura de funcionamiento de -40°C a +85°C

Notas

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