AD9643BCPZ-250

El AD9643 es un ADC dual de 14 bits con velocidades de muestreo de hasta 250MSPS. El AD9643 está diseñado para soportar aplicaciones de comunicaciones, donde se desea bajo costo, tamaño pequeño, amplio ancho de banda y versatilidad. El núcleo ADC dual cuenta con una arquitectura canalizada diferencial de varias etapas con lógica de corrección de errores de salida integrada. Cada ADC presenta entradas de ancho de banda amplio que admiten una variedad de rangos de entrada seleccionables por el usuario. Una referencia de voltaje integrada facilita las consideraciones de diseño. Se proporciona un estabilizador de ciclo de trabajo para compensar las variaciones en el ciclo de trabajo del reloj ADC, lo que , permite que los convertidores mantengan un rendimiento excelente. La aplicación típica incluye comunicaciones, sistemas de radio de diversidad, receptores digitales multimodo 3G (TD-SCDMA, WiMax, WCDMA, CDMA2000, GSM, EDGE, LTE), sistemas de demodulación I/Q, sistemas de antena inteligente, radios de software de uso general, equipos de ultrasonido y Aplicaciones de datos de banda ancha.

• SNR de 70.6dBFS a 185MHz AIN y 250MSPS y SFDR de 85dBc a 185MHz AIN y 250MSPS
• (-) Ruido de entrada de 151.6 dBFS/Hz a 185 MHz, -1 dBFS AIN y 250MSPS
• Consumo total de energía de 785mW a 250MSPS
• Voltaje de alimentación de 1.8V y salidas LVDS (niveles ANSI-644)
• Divisor de reloj de entrada entero de 1 a 8 (entrada máxima de 625MHz), frecuencias de muestreo de hasta 250MSPS
• Frecuencias de muestreo de FI de hasta 400MHz, referencia de voltaje ADC interno y control de puerto serie
• Estabilizador de ciclo de trabajo de reloj ADC, aislamiento de canal de 95dB/diafonía y modos de apagado de ahorro de energía
• Rango de entrada analógica flexible de 1.4Vp-p a 2.0Vp-p (1.75Vp-p nominal)
• Paquete LFCSP-VQ-EP de 64 derivaciones
• Rango de temperatura de operación de -40°C a 85°C

Notas

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