ADP1740ACPZ-1.3-R7

El ADP1740 es un regulador lineal CMOS de caída baja (LDO) que funciona de 1.6V a 3.6V y proporciona hasta 2A de corriente de salida. Este LDO de bajo VIN/VOUT es ideal para la regulación de geometrías FPGA nanométricas que operan desde 2.5V hasta rieles de E/S de 1.8V, y para alimentar voltajes centrales de hasta 0.75V. Usando una arquitectura patentada avanzada, esto proporciona una alta tasa de rechazo de la fuente de alimentación (PSRR) y bajo nivel de ruido, y logra una excelente respuesta transitoria de línea y carga con solo un pequeño capacitor de salida de cerámica de 4.7µF. Esto permite conectar un condensador de arranque suave externo para programar el arranque. Una salida digital de buena potencia permite que los monitores del sistema de potencia verifiquen el estado del voltaje de salida. Las aplicaciones típicas son servidores, componentes de memoria, equipos de telecomunicaciones, equipos de red, DSP/FPGA/suministros de microprocesadores, equipos de instrumentación/sistemas de adquisición de datos.

• Estable con capacitor de salida de cerámica pequeño de 4.7µF, indicador de potencia buena
• Excelente respuesta transitoria de línea y carga, habilitación controlada por lógica
• Protección de límite de corriente y sobrecarga térmica, protección de corriente inversa
• Rango de tensión de entrada de 1.6 a 3.6V (TJ=−40°C a +125 °C, VIN=(VOUT + 0.4V) o 1.6V, IOUT=100mA)
• La corriente de apagado es de 6µA máx. (EN=GND, VIN=3.6V, VIN=VOUT + 0.4V o 1.6V, IOUT=100mA, CIN=COUT=4.7µF)
• Voltaje de salida 1.3V
• El voltaje de caída es de 10mV típico (IOUT = 100mA, VOUT ≥ 1.8V, VIN = (VOUT + 0.4V) o 1.6V, TA = 25 °C)
• El ruido de salida es de 23µV rms típico (10Hz a 100KHz, VOUT=0.75V, VIN=(VOUT + 0.4V) o 1.6V, TA=25 °C)
• Paquete LFCSP- WQ de 16 - terminales
• Rango de temperatura nominal de -40°C a +125°C

Notas

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